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  1. Aliee, Hananeh [VerfasserIn] ; Glaß, Michael [Sonstige Person, Familie und Körperschaft]; Teich, Jürgen [Sonstige Person, Familie und Körperschaft]; Wunderlich, Hans-Joachim [Sonstige Person, Familie und Körperschaft]

    Reliability Analysis and Optimization of Embedded Systems using Stochastic Logic and Importance Measures

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    Erlangen: Friedrich-Alexander-Universität Erlangen-Nürnberg (FAU), 2017

  2. Becker, Klaus [VerfasserIn] ; Broy, Manfred [AkademischeR BetreuerIn]; Broy, Manfred [Sonstige Person, Familie und Körperschaft]; Teich, Jürgen [Sonstige Person, Familie und Körperschaft]

    Software Deployment Analysis for Mixed Reliability Automotive Systems

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    München: Universitätsbibliothek der TU München, 2017

  3. Trenkel, Kristian [VerfasserIn] ; Heinkel, Ulrich [AkademischeR BetreuerIn]; Heinkel, Ulrich [Sonstige Person, Familie und Körperschaft]; Teich, Jürgen [Sonstige Person, Familie und Körperschaft]

    Konzept und Umsetzung einer modularen, portierbaren Middleware für den automatisierten Test eingebetteter Systeme

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    Chemnitz: Universitätsbibliothek Chemnitz; Chemnitz: Universitätsverlag der Technischen Universität Chemnitz, 2016

  4. Zebelein, Christian [VerfasserIn] ; Haubelt, Christian [Sonstige Person, Familie und Körperschaft]; Teich, Jürgen [Sonstige Person, Familie und Körperschaft]; Basten, Twan [Sonstige Person, Familie und Körperschaft]

    A model-based approach for the specification and refinement of streaming applications

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    Rostock: Universität Rostock, 2015

  5. Litzinger, Sebastian Georg [VerfasserIn] ; Keller, Jörg [AkademischeR BetreuerIn]; Keller, Jörg [Sonstige Person, Familie und Körperschaft]; Teich, Jürgen [Sonstige Person, Familie und Körperschaft]

    Raising Energy Efficiency and Fault Tolerance with Parallel Streaming Application Scheduling on Multicore Systems

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    Hagen: FernUniversität in Hagen, 2023

  6. Anantharajaiah, Nidhi [VerfasserIn]; Asfour, Tamim [VerfasserIn]; Bader, Michael [VerfasserIn]; Bauer, Lars [VerfasserIn]; Becker, Jürgen [VerfasserIn]; Bischof, Simon [VerfasserIn]; Brand, Marcel [VerfasserIn]; Bungartz, Hans-Joachim [VerfasserIn]; Eichler, Christian [VerfasserIn]; Esper, Khalil [VerfasserIn]; Falk, Joachim [VerfasserIn]; Fasfous, Nael [VerfasserIn]; Freiling, Felix [VerfasserIn]; Fried, Andreas [VerfasserIn]; Gerndt, Michael [VerfasserIn]; Glaß, Michael [VerfasserIn]; Gonzalez, Jeferson [VerfasserIn]; Hannig, Frank [VerfasserIn]; Heidorn, Christian [VerfasserIn]; Henkel, Jörg [VerfasserIn]; Herkersdorf, Andreas [VerfasserIn]; Herzog, Benedict [VerfasserIn]; John, Jophin [VerfasserIn]; Hönig, Timo [VerfasserIn]; [...] ; Teich, Jürgen [HerausgeberIn]; Henkel, Jörg [HerausgeberIn]; Herkersdorf, Andreas [HerausgeberIn] FAU University Press ein Imprint der Universität Erlangen-Nürnberg Universitätsbibliothek

    Invasive Computing

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    Erlangen: FAU University Press, 2022

  7. Trautmann,  Jens [VerfasserIn] ; Wildermann,  Stefan [AkademischeR BetreuerIn]; Teich,  Jürgen [AkademischeR BetreuerIn]; Wildermann,  Stefan [Sonstige Person, Familie und Körperschaft]; Mentens,  Nele [Sonstige Person, Familie und Körperschaft]; Freiling,  Felix [Sonstige Person, Familie und Körperschaft]

    Automation Approaches for the Application of Side-Channel Analysis in Real-World Scenarios

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    Erlangen: Friedrich-Alexander-Universität Erlangen-Nürnberg (FAU), 2023

  8. Betting, Benjamin [VerfasserIn] ; Brinkschulte, Uwe [AkademischeR BetreuerIn]; Brinkschulte, Uwe [Sonstige Person, Familie und Körperschaft]; Hedrich, Lars [Sonstige Person, Familie und Körperschaft]; Teich, Jürgen [Sonstige Person, Familie und Körperschaft]

    ˜Einœ organisches Taskverarbeitungssystem für zuverlässige Multi-Core SoC-Architekturen

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    Frankfurt am Main: Universitätsbibliothek Johann Christian Senckenberg, 2016

  9. Letras, Martin [VerfasserIn]; Falk, Joachim [VerfasserIn]; Teich, Jürgen [VerfasserIn] ; Martin Letras and Joachim Falk and Jürgen Teich [MitwirkendeR]

    Throughput and Memory Optimization for Parallel Implementations of Dataflow Networks Using Multi-Reader Buffers

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    Schloss Dagstuhl – Leibniz-Zentrum für Informatik, 2023

  10. Esper, Khalil [VerfasserIn]; Wildermann, Stefan [VerfasserIn]; Teich, Jürgen [VerfasserIn] ; Khalil Esper and Stefan Wildermann and Jürgen Teich [MitwirkendeR]

    Multi-Requirement Enforcement of Non-Functional Properties on MPSoCs Using Enforcement FSMs - A Case Study

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    Schloss Dagstuhl – Leibniz-Zentrum für Informatik, 2022

  11. Esper, Khalil [VerfasserIn]; Wildermann, Stefan [VerfasserIn]; Teich, Jürgen [VerfasserIn] ; Khalil Esper and Stefan Wildermann and Jürgen Teich [MitwirkendeR]

    A Comparative Evaluation of Latency-Aware Energy Optimization Approaches in Many-Core Systems (Invited Paper)

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    Schloss Dagstuhl – Leibniz-Zentrum für Informatik, 2021

  12. Mitra, Tulika [VerfasserIn]; Teich, Jürgen [VerfasserIn]; Thiele, Lothar [VerfasserIn] ; Tulika Mitra and Jürgen Teich and Lothar Thiele [MitwirkendeR]

    Adaptive Isolation for Predictability and Security (Dagstuhl Seminar 16441)

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    Schloss Dagstuhl – Leibniz-Zentrum für Informatik, 2017

  13. Göhringer, Diana [VerfasserIn]; Majer, Mateusz [VerfasserIn]; Teich, Jürgen [VerfasserIn] ; Diana Göhringer and Mateusz Majer and Jürgen Teich [MitwirkendeR]

    Bridging the Gap between Relocatability and Available Technology: The Erlangen Slot Machine

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    Schloss Dagstuhl – Leibniz-Zentrum für Informatik, 2006

  14. Trautmann,  Jens [VerfasserIn] ; Wildermann,  Stefan [AkademischeR BetreuerIn]; Teich,  Jürgen [AkademischeR BetreuerIn]; Wildermann,  Stefan [Sonstige Person, Familie und Körperschaft]; Mentens,  Nele [Sonstige Person, Familie und Körperschaft]; Freiling,  Felix [Sonstige Person, Familie und Körperschaft]

    Automation Approaches for the Application of Side-Channel Analysis in Real-World Scenarios

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    Erlangen: Friedrich-Alexander-Universität Erlangen-Nürnberg (FAU), 2023

  15. Teich, Jürgen [VerfasserIn]; Zitzler, Eckart [VerfasserIn]; Bhattacharyya, Shuvra S. [VerfasserIn]

    3D exploration of Uniprocessor Schedules for DSP algorithms

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    ETH Zurich, Computer Engineering and Networks Laboratory, 1999-04

    Erschienen in: TIK Report, 56

  16. Zitzler, Eckart [VerfasserIn]; Teich, Jürgen [VerfasserIn]; Bhattacharyya, Shuvra S. [VerfasserIn]

    Optimized software synthesis for DSP using randomization techniques: (Revised version of TIK Report 32)

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    ETH Zurich, Computer Engineering and Networks Laboratory, 1999-07

    Erschienen in: TIK Report, 75

  17. Teich, Jürgen [VerfasserIn]; Zitzler, Eckart [VerfasserIn]; Bhattacharyya, Shuvra S. [VerfasserIn]

    Optimized software synthesis for digital signal processing algorithms - an evolutionary approach

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    ETH Zurich, Computer Engineering and Networks Laboratory, 1998-01

    Erschienen in: TIK Report, 32

  18. Athanas, Peter M. [VerfasserIn]; Becker, Jürgen [VerfasserIn]; Teich, Jürgen [VerfasserIn]; Verbauwhede, Ingrid [VerfasserIn] ; Peter M. Athanas and Jürgen Becker and Jürgen Teich and Ingrid Verbauwhede [MitwirkendeR]

    10281 Abstracts Collection – Dynamically Reconfigurable Architectures

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    Schloss Dagstuhl – Leibniz-Zentrum für Informatik, 2010

  19. Athanas, Peter M. [VerfasserIn]; Becker, Jürgen [VerfasserIn]; Teich, Jürgen [VerfasserIn]; Verbauwhede, Ingrid [VerfasserIn] ; Peter M. Athanas and Jürgen Becker and Jürgen Teich and Ingrid Verbauwhede [MitwirkendeR]

    10281 Summary – Dynamically Reconfigurable Architectures

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    Schloss Dagstuhl – Leibniz-Zentrum für Informatik, 2010

  20. Becker, Jürgen [VerfasserIn]; Teich, Jürgen [VerfasserIn]; Brebner, Gordon [VerfasserIn]; Athanas, Peter M. [VerfasserIn] ; Jürgen Becker and Jürgen Teich and Gordon Brebner and Peter M. Athanas [MitwirkendeR]

    06141 Abstracts Collection – Dynamically Reconfigurable Architectures

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    Schloss Dagstuhl – Leibniz-Zentrum für Informatik, 2006