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  4. Streit, Franz-Josef [VerfasserIn] ; Teich, Jürgen [AkademischeR BetreuerIn]; Teich, Jürgen [Sonstige Person, Familie und Körperschaft]

    Techniques to Secure HW/SW-Programmable SoC Architectures for Edge Computing

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    Erlangen: Friedrich-Alexander-Universität Erlangen-Nürnberg (FAU), 2023

  5. Witterauf, Michael [VerfasserIn] ; Teich, Jürgen [AkademischeR BetreuerIn]; Teich, Jürgen [Sonstige Person, Familie und Körperschaft]

    A Compiler for Symbolic Code Generation for Tightly Coupled Processor Arrays

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    Erlangen: Friedrich-Alexander-Universität Erlangen-Nürnberg (FAU), 2021

  6. Streit, Franz-Josef [VerfasserIn] ; Teich, Jürgen [AkademischeR BetreuerIn]; Teich, Jürgen [Sonstige Person, Familie und Körperschaft]

    Techniques to Secure HW/SW-Programmable SoC Architectures for Edge Computing

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    Erlangen: Friedrich-Alexander-Universität Erlangen-Nürnberg (FAU), 2023

  7. Witterauf, Michael [VerfasserIn] ; Teich, Jürgen [AkademischeR BetreuerIn]; Teich, Jürgen [Sonstige Person, Familie und Körperschaft]

    A Compiler for Symbolic Code Generation for Tightly Coupled Processor Arrays

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    Erlangen: Friedrich-Alexander-Universität Erlangen-Nürnberg (FAU), 2021

  8. Rosales, Rafael [VerfasserIn] ; Teich, Jürgen [Sonstige Person, Familie und Körperschaft]

    Holistic Actor-Oriented Modeling of Embedded Systems for ESL Power Consumption Evaluation

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    Erlangen: Friedrich-Alexander-Universität Erlangen-Nürnberg (FAU), 2017

  12. Kern, Andreas [VerfasserIn] ; Teich, Jürgen [AkademischeR BetreuerIn]

    Ethernet and IP for Automotive E/E-Architectures - Technology Analysis, Migration Concepts and Infrastructure

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    Erlangen: Friedrich-Alexander-Universität Erlangen-Nürnberg (FAU), 2013

  14. Wildermann, Stefan [VerfasserIn] ; Teich, Jürgen [AkademischeR BetreuerIn]

    Systematic Design of Self-Adaptive Embedded Systems with Applications in Image Processing

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    Erlangen: Universitätsbibliothek der Universität Erlangen-Nürnberg, 2013

  15. Gladigau, Jens [VerfasserIn] ; Jürgen, Teich [AkademischeR BetreuerIn]

    Combining Formal Model-Based System-Level Design with SystemC Transaction Level Modeling

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    Erlangen: Universitätsbibliothek der Universität Erlangen-Nürnberg, 2012

  16. Kissler, Dmitrij [VerfasserIn] ; Teich, Jürgen [AkademischeR BetreuerIn]

    Power-Efficient Tightly-Coupled Processor Arrays for Digital Signal Processing

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    Erlangen: Universitätsbibliothek der Universität Erlangen-Nürnberg, 2012

  17. Majer, Mateusz [VerfasserIn] ; Teich, Jürgen [AkademischeR BetreuerIn]

    ˜Theœ Erlangen Slot Machine - An FPGA-Based Partially Reconfigurable Computer

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    Erlangen: Universitätsbibliothek der Universität Erlangen-Nürnberg, 2011

  18. Ziener, Daniel [VerfasserIn] ; Teich, Jürgen [Sonstige Person, Familie und Körperschaft]

    Techniques for Increasing Security and Reliability of IP Cores Embedded in FPGA and ASIC Designs

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    Erlangen: Friedrich-Alexander-Universität Erlangen-Nürnberg (FAU), 2010

  19. Haubelt, Christian [VerfasserIn] ; Teich, Jürgen [Sonstige Person, Familie und Körperschaft]

    Digitale Hardware/Software-Systeme : Spezifikation und Verifikation

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    Berlin, Heidelberg: Springer-Verlag Berlin Heidelberg, 2010

    Erschienen in: eXamen.press ; 0- SpringerLink ; Bücher

  20. Becher, Andreas [VerfasserIn] ; Teich, Jürgen [AkademischeR BetreuerIn]; Teich, Jürgen [Sonstige Person, Familie und Körperschaft]; Teubner, Jens [Sonstige Person, Familie und Körperschaft]

    Near-Data Query Processing on Heterogeneous FPGA-based Systems

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    Erlangen: Friedrich-Alexander-Universität Erlangen-Nürnberg (FAU), 2022