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  1. Bellido, Manuel J. [VerfasserIn]; Chico, Jorge Juan [VerfasserIn]; Valencia, Manuel [VerfasserIn] ; Juan, Jorge [Sonstige Person, Familie und Körperschaft]

    Logic-timing simulation and the degradation delay model

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    London: Imperial College Press, c 2006

  2. Mengali, Umberto [VerfasserIn]; D'Andrea, Aldo N. [VerfasserIn]

    Synchronization techniques for digital receivers

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    New York [u.a.]: Plenum Press, c1997

    Erschienen in: Applications of communications theory

  3. Srivastava, Ashish [VerfasserIn]; Sylvester, Dennis [VerfasserIn] ; Blaauw, David T. [Sonstige Person, Familie und Körperschaft]; Blaauw, David [Sonstige Person, Familie und Körperschaft]

    Statistical analysis and optimization for VLSI: timing and power

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    New York, NY: Springer Science + Business Media, 2005