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  1. Kampen, Christian [VerfasserIn] ; Ryssel, Heiner [AkademischeR BetreuerIn]

    Evaluation of CMOS Architectures Below 50 nm Gate Length by Numerical Simulations

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    Erlangen: Friedrich-Alexander-Universität Erlangen-Nürnberg (FAU), 2011

  2. Spruth, Wilhelm G. [VerfasserIn]; Hering, Klaus [VerfasserIn]; Haupt, Reiner [VerfasserIn]; Petri, Udo [VerfasserIn]

    Zwischenbericht zur Arbeit im DFG-Projekt 'Modellpartitionierung, Logiksimulation

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    Leipzig: Universität Leipzig, 1997

    Erschienen in: Report ; 1997,6

  3. Spruth, Wilhelm G. [VerfasserIn]; Hering, Klaus [VerfasserIn]; Haupt, Reiner [VerfasserIn]; Petri, U. [VerfasserIn]

    Zwischenbericht zur Arbeit im DFG-Projekt 'Partitionierungsalgorithmen für Modelldatenstrukturen zur parallelen compilergesteuerten Logiksimulation

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    Leipzig: Universität Leipzig, 1999

    Erschienen in: Report ; 1999,2

  4. Hering, Klaus [VerfasserIn]; Haupt, Reiner [VerfasserIn]; Villmann, Thomas [VerfasserIn]

    Cone-basierte, hierarchische Modellpartitionierung zur parallelen compilergesteuerten Logiksimulation beim VLSI-Design

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    Leipzig: Universität Leipzig, 1995

    Erschienen in: Report ; 1995,13